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Apple ist mit den SoC voraus, aber der Trend bei Intel und vor allem AMD gehen auch in die Richtung.Epyc sind auch SoC in dem Sinne das sie keinen Chipsatz haben und alles (ausser dem RAM) in der CPU sitzen.Intels Xeon haben mittlerweile auch HBM als RAM direkt im Chip.Apple könnte ähnliche Wege gehen und z.B. RAM im SoC mit erweiterbarem RAM auf dem Board kombinieren.

Auf AMD Seite ist der PSP direkt auf der CPU. Es ging mir mehr darum, dass der Trend zur integration in die CPU auch bei x86 nicht halt macht. DDR5 verursacht jetzt schon Probleme aufgrund der hohen Transferraten, früher oder später kommt auch bei x86 RAM direkt auf die CPU. DSM2 Bei SPR-HBM kann HBM in verschiedenen Modi betrieben werden. Default transparent als Cache für normalen RAM, "App Direct" können Anwendungen selber den Speicher verwalten oder rein HBM only ohne zusätzlichen externen RA…

TheWachowski Grund das wir noch warten dürfte eine Hardwarelimitation im M1 sein... Die 32MB TLB scheinen im M1 Ultra zu verhindern, dass vor allem die GPU nicht mehr richtig skaliert (Twitter thread)Apple musste daher auf eine Korrektur im M2 warten. Die Verzögerungen von TSMCs 3nm haben den M2 ebenfalls zurückgeworfen.

Nicht nur Latenz, auch Breite des Interfaces: M1 hat 2 Channels, Pro 4 Channels, Max 8 Channels und Ultra 16 Channels.